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ADE7953
Data Sheet
TIMING CHARACTERISTICS
SPI Interface Timing
VDD = 3.3 V ± 10%, AGND = DGND = 0 V, on-chip reference, CLKIN = 3.58 MHz, T MIN to T MAX = ?40°C to +85°C, unless otherwise noted.
Table 2.
Parameter
Description
Min 1
Max 1
Unit
t CS
t SCLK
t SL
t SH
t DAV
t DSU
t DHD
t DF
t DR
t SR
t SF
CS to SCLK edge
SCLK period
SCLK low pulse width
SCLK high pulse width
Data output valid after SCLK edge
Data input setup time before SCLK edge
Data input hold time after SCLK edge
Data output fall time
Data output rise time
SCLK rise time
SCLK fall time
50
200
80
80
70
5
80
20
20
20
20
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
t DIS
t SFS
t SFS_LK
MISO disabled after CS rising edge
CS high after SCLK edge
CS high after SCLK edge (when writing to
5
0
1200
40
ns
ns
ns
COMM_LOCK bit)
1
Min and max values are typical minimum and maximum values.
SPI Interface Timing Diagram
CS
t CS
t SCLK
t SFS_LK
t SFS
SCLK
t SL
t DAV
t SH
t SF
t SR
t DIS
MISO
MSB OUT
INTERMEDIATE BITS
t DF
LSB OUT
t DR
INTERMEDIATE BITS
MOSI
t DSU
MSB IN
t DHD
Figure 2. SPI Interface Timing
Rev. B | Page 6 of 72
LSB IN
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